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商品説明
SystemVerilogによるハードウェア検証技術を、基礎から応用まで幅広く、丁寧に解説。多数のソースコードとシミュレーション例を通して、実践的な知識が身につく。【「TRC MARC」の商品解説】
SystemVerilogによるハードウェア検証技術を詳説!
検証に必要なSystemVerilogの基本知識をカバーしつつ、
ランダムスティミュラスの生成、ファンクショナルカバレッジ、
アサーション、さらにはUVMを利用した検証作業について、
膨大な言語仕様の中から重要ポイントをピックアップし、丁寧にひもときます。
コードの記述例も多数掲載。手を動かしながら読み進めることによって、
複雑かつ見落としやすい仕様を、実践的に身につけられるよう工夫されています。
検証作業に携わるエンジニア必読の1冊。【商品解説】
目次
- 第1章 概要
- 第2章 SystemVerilogに関する予備知識
- 第3章 ランダムスティミュラスの生成
- 第4章 ファンクショナルカバレッジ
- 第5章 アサーション
- 第6章 UVM
- 第7章 補足
著者紹介
篠塚 一也
- 略歴
- 〈篠塚一也〉名古屋大学理学研究科数学研究生修了。第二精工舎(現セイコーインスツル)、GE Calma等を経て、自社アートグラフィックスのEDA製品開発を担当。
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